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  对于表达式a && b,当a为假时,整个逻辑表达式的结果必为假,评估表达式b的值是不必要的。同样的情况也发生在表达式c || d中,当c为真时,d的真假不影响整个表达式的值。在上述情形下,编译器会略过表达式b和d的运算,这种行为就好比电路“短路”时,电流总是沿阻抗最低的“近路”行进,称之为“布尔运算的短路”。